Classic Timing Analyzer report for ProjetoULA_Display
Thu Oct 15 17:26:58 2009
Quartus II Version 8.0 Build 215 05/29/2008 SJ Full Version


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; Table of Contents ;
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  1. Legal Notice
  2. Timing Analyzer Summary
  3. Timing Analyzer Settings
  4. tpd
  5. Timing Analyzer Messages



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; Legal Notice ;
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Copyright (C) 1991-2008 Altera Corporation
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and other software and tools, and its AMPP partner logic 
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+----------------------------------------------------------------------------------------------------------------------------------+
; Timing Analyzer Summary                                                                                                          ;
+------------------------------+-------+---------------+-------------+--------+-------------+------------+----------+--------------+
; Type                         ; Slack ; Required Time ; Actual Time ; From   ; To          ; From Clock ; To Clock ; Failed Paths ;
+------------------------------+-------+---------------+-------------+--------+-------------+------------+----------+--------------+
; Worst-case tpd               ; N/A   ; None          ; 42.900 ns   ; Sel[0] ; Display1[5] ; --         ; --       ; 0            ;
; Total number of failed paths ;       ;               ;             ;        ;             ;            ;          ; 0            ;
+------------------------------+-------+---------------+-------------+--------+-------------+------------+----------+--------------+


+--------------------------------------------------------------------------------------------------------------------+
; Timing Analyzer Settings                                                                                           ;
+---------------------------------------------------------------------+--------------------+------+----+-------------+
; Option                                                              ; Setting            ; From ; To ; Entity Name ;
+---------------------------------------------------------------------+--------------------+------+----+-------------+
; Device Name                                                         ; EPF10K20RC240-4    ;      ;    ;             ;
; Timing Models                                                       ; Final              ;      ;    ;             ;
; Default hold multicycle                                             ; Same as Multicycle ;      ;    ;             ;
; Cut paths between unrelated clock domains                           ; On                 ;      ;    ;             ;
; Cut off read during write signal paths                              ; On                 ;      ;    ;             ;
; Cut off feedback from I/O pins                                      ; On                 ;      ;    ;             ;
; Report Combined Fast/Slow Timing                                    ; Off                ;      ;    ;             ;
; Ignore Clock Settings                                               ; Off                ;      ;    ;             ;
; Analyze latches as synchronous elements                             ; On                 ;      ;    ;             ;
; Enable Recovery/Removal analysis                                    ; Off                ;      ;    ;             ;
; Enable Clock Latency                                                ; Off                ;      ;    ;             ;
; Use TimeQuest Timing Analyzer                                       ; Off                ;      ;    ;             ;
; Number of source nodes to report per destination node               ; 10                 ;      ;    ;             ;
; Number of destination nodes to report                               ; 10                 ;      ;    ;             ;
; Number of paths to report                                           ; 200                ;      ;    ;             ;
; Report Minimum Timing Checks                                        ; Off                ;      ;    ;             ;
; Use Fast Timing Models                                              ; Off                ;      ;    ;             ;
; Report IO Paths Separately                                          ; Off                ;      ;    ;             ;
; Perform Multicorner Analysis                                        ; Off                ;      ;    ;             ;
; Reports the worst-case path for each clock domain and analysis      ; Off                ;      ;    ;             ;
; Removes common clock path pessimism (CCPP) during slack computation ; Off                ;      ;    ;             ;
+---------------------------------------------------------------------+--------------------+------+----+-------------+


+--------------------------------------------------------------------+
; tpd                                                                ;
+-------+-------------------+-----------------+--------+-------------+
; Slack ; Required P2P Time ; Actual P2P Time ; From   ; To          ;
+-------+-------------------+-----------------+--------+-------------+
; N/A   ; None              ; 42.900 ns       ; Sel[0] ; Display1[5] ;
; N/A   ; None              ; 41.400 ns       ; Sel[0] ; Display1[4] ;
; N/A   ; None              ; 41.300 ns       ; Sel[0] ; Display1[0] ;
; N/A   ; None              ; 39.600 ns       ; A[0]   ; Display1[5] ;
; N/A   ; None              ; 39.400 ns       ; B[0]   ; Display1[5] ;
; N/A   ; None              ; 38.400 ns       ; Sel[0] ; Display1[1] ;
; N/A   ; None              ; 38.400 ns       ; Sel[0] ; Display1[6] ;
; N/A   ; None              ; 38.100 ns       ; A[0]   ; Display1[4] ;
; N/A   ; None              ; 38.000 ns       ; A[0]   ; Display1[0] ;
; N/A   ; None              ; 38.000 ns       ; Sel[0] ; Display1[2] ;
; N/A   ; None              ; 37.900 ns       ; B[0]   ; Display1[4] ;
; N/A   ; None              ; 37.800 ns       ; B[0]   ; Display1[0] ;
; N/A   ; None              ; 36.400 ns       ; A[1]   ; Display1[5] ;
; N/A   ; None              ; 36.100 ns       ; B[1]   ; Display1[5] ;
; N/A   ; None              ; 35.900 ns       ; A[2]   ; Display1[5] ;
; N/A   ; None              ; 35.100 ns       ; A[0]   ; Display1[1] ;
; N/A   ; None              ; 35.100 ns       ; Sel[1] ; Display1[5] ;
; N/A   ; None              ; 35.100 ns       ; A[0]   ; Display1[6] ;
; N/A   ; None              ; 34.900 ns       ; B[0]   ; Display1[1] ;
; N/A   ; None              ; 34.900 ns       ; A[1]   ; Display1[4] ;
; N/A   ; None              ; 34.900 ns       ; B[0]   ; Display1[6] ;
; N/A   ; None              ; 34.800 ns       ; A[1]   ; Display1[0] ;
; N/A   ; None              ; 34.700 ns       ; A[0]   ; Display1[2] ;
; N/A   ; None              ; 34.600 ns       ; B[1]   ; Display1[4] ;
; N/A   ; None              ; 34.500 ns       ; B[1]   ; Display1[0] ;
; N/A   ; None              ; 34.500 ns       ; B[0]   ; Display1[2] ;
; N/A   ; None              ; 34.500 ns       ; Sel[0] ; Display1[3] ;
; N/A   ; None              ; 34.400 ns       ; A[2]   ; Display1[4] ;
; N/A   ; None              ; 34.300 ns       ; A[2]   ; Display1[0] ;
; N/A   ; None              ; 34.200 ns       ; Sel[2] ; Display1[5] ;
; N/A   ; None              ; 33.600 ns       ; Sel[1] ; Display1[4] ;
; N/A   ; None              ; 33.500 ns       ; Sel[1] ; Display1[0] ;
; N/A   ; None              ; 33.500 ns       ; Sel[0] ; Over        ;
; N/A   ; None              ; 33.400 ns       ; Sel[0] ; Display2[6] ;
; N/A   ; None              ; 32.600 ns       ; Sel[2] ; Display1[0] ;
; N/A   ; None              ; 32.400 ns       ; Sel[2] ; Display1[4] ;
; N/A   ; None              ; 32.300 ns       ; A[3]   ; Display1[5] ;
; N/A   ; None              ; 32.000 ns       ; B[0]   ; Statu       ;
; N/A   ; None              ; 31.900 ns       ; A[1]   ; Display1[1] ;
; N/A   ; None              ; 31.900 ns       ; B[2]   ; Display1[5] ;
; N/A   ; None              ; 31.900 ns       ; A[1]   ; Display1[6] ;
; N/A   ; None              ; 31.700 ns       ; A[0]   ; Statu       ;
; N/A   ; None              ; 31.600 ns       ; B[1]   ; Display1[1] ;
; N/A   ; None              ; 31.600 ns       ; B[1]   ; Display1[6] ;
; N/A   ; None              ; 31.600 ns       ; B[1]   ; Statu       ;
; N/A   ; None              ; 31.500 ns       ; A[1]   ; Display1[2] ;
; N/A   ; None              ; 31.400 ns       ; A[2]   ; Display1[1] ;
; N/A   ; None              ; 31.400 ns       ; A[2]   ; Display1[6] ;
; N/A   ; None              ; 31.200 ns       ; B[1]   ; Display1[2] ;
; N/A   ; None              ; 31.200 ns       ; A[0]   ; Display1[3] ;
; N/A   ; None              ; 31.000 ns       ; A[2]   ; Display1[2] ;
; N/A   ; None              ; 31.000 ns       ; B[0]   ; Display1[3] ;
; N/A   ; None              ; 31.000 ns       ; A[1]   ; Statu       ;
; N/A   ; None              ; 30.800 ns       ; A[3]   ; Display1[4] ;
; N/A   ; None              ; 30.700 ns       ; A[3]   ; Display1[0] ;
; N/A   ; None              ; 30.600 ns       ; Sel[1] ; Display1[1] ;
; N/A   ; None              ; 30.600 ns       ; Sel[1] ; Display1[6] ;
; N/A   ; None              ; 30.600 ns       ; A[2]   ; Statu       ;
; N/A   ; None              ; 30.400 ns       ; B[2]   ; Display1[4] ;
; N/A   ; None              ; 30.300 ns       ; B[2]   ; Display1[0] ;
; N/A   ; None              ; 30.200 ns       ; Sel[1] ; Display1[2] ;
; N/A   ; None              ; 30.200 ns       ; Sel[1] ; Display1[3] ;
; N/A   ; None              ; 30.200 ns       ; A[0]   ; Over        ;
; N/A   ; None              ; 30.100 ns       ; A[0]   ; Display2[6] ;
; N/A   ; None              ; 30.000 ns       ; B[0]   ; Over        ;
; N/A   ; None              ; 29.900 ns       ; B[0]   ; Display2[6] ;
; N/A   ; None              ; 29.700 ns       ; Sel[2] ; Display1[1] ;
; N/A   ; None              ; 29.700 ns       ; Sel[2] ; Display1[3] ;
; N/A   ; None              ; 29.400 ns       ; Sel[2] ; Display1[6] ;
; N/A   ; None              ; 29.300 ns       ; Sel[2] ; Display1[2] ;
; N/A   ; None              ; 29.200 ns       ; B[3]   ; Display1[5] ;
; N/A   ; None              ; 28.700 ns       ; A[2]   ; Display1[3] ;
; N/A   ; None              ; 28.000 ns       ; A[1]   ; Display1[3] ;
; N/A   ; None              ; 27.800 ns       ; A[3]   ; Display1[1] ;
; N/A   ; None              ; 27.800 ns       ; A[3]   ; Display1[6] ;
; N/A   ; None              ; 27.700 ns       ; B[1]   ; Display1[3] ;
; N/A   ; None              ; 27.700 ns       ; B[3]   ; Display1[4] ;
; N/A   ; None              ; 27.600 ns       ; B[3]   ; Display1[0] ;
; N/A   ; None              ; 27.600 ns       ; B[2]   ; Statu       ;
; N/A   ; None              ; 27.400 ns       ; B[2]   ; Display1[1] ;
; N/A   ; None              ; 27.400 ns       ; A[3]   ; Display1[2] ;
; N/A   ; None              ; 27.400 ns       ; B[2]   ; Display1[6] ;
; N/A   ; None              ; 27.000 ns       ; B[2]   ; Display1[2] ;
; N/A   ; None              ; 27.000 ns       ; A[1]   ; Over        ;
; N/A   ; None              ; 26.900 ns       ; A[1]   ; Display2[6] ;
; N/A   ; None              ; 26.700 ns       ; B[1]   ; Over        ;
; N/A   ; None              ; 26.600 ns       ; B[1]   ; Display2[6] ;
; N/A   ; None              ; 26.500 ns       ; A[2]   ; Over        ;
; N/A   ; None              ; 26.400 ns       ; A[2]   ; Display2[6] ;
; N/A   ; None              ; 25.800 ns       ; A[3]   ; Statu       ;
; N/A   ; None              ; 25.700 ns       ; B[2]   ; Display1[3] ;
; N/A   ; None              ; 25.600 ns       ; Sel[1] ; Display2[6] ;
; N/A   ; None              ; 24.700 ns       ; B[3]   ; Display1[1] ;
; N/A   ; None              ; 24.700 ns       ; B[3]   ; Display1[6] ;
; N/A   ; None              ; 24.400 ns       ; Sel[2] ; Display2[6] ;
; N/A   ; None              ; 24.300 ns       ; B[3]   ; Display1[2] ;
; N/A   ; None              ; 23.700 ns       ; Sel[0] ; Statu       ;
; N/A   ; None              ; 23.500 ns       ; Sel[1] ; Statu       ;
; N/A   ; None              ; 22.900 ns       ; A[3]   ; Over        ;
; N/A   ; None              ; 22.800 ns       ; A[3]   ; Display2[6] ;
; N/A   ; None              ; 22.500 ns       ; B[2]   ; Over        ;
; N/A   ; None              ; 22.400 ns       ; B[2]   ; Display2[6] ;
; N/A   ; None              ; 22.000 ns       ; Sel[2] ; Statu       ;
; N/A   ; None              ; 21.700 ns       ; B[3]   ; Statu       ;
; N/A   ; None              ; 19.800 ns       ; B[3]   ; Over        ;
; N/A   ; None              ; 19.700 ns       ; B[3]   ; Display2[6] ;
; N/A   ; None              ; 18.800 ns       ; Sel[1] ; Over        ;
; N/A   ; None              ; 18.500 ns       ; Sel[2] ; Over        ;
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+--------------------------+
; Timing Analyzer Messages ;
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Info: *******************************************************************
Info: Running Quartus II Classic Timing Analyzer
    Info: Version 8.0 Build 215 05/29/2008 SJ Full Version
    Info: Processing started: Thu Oct 15 17:26:54 2009
Info: Command: quartus_tan --read_settings_files=off --write_settings_files=off ProjetoULA_Display -c ProjetoULA_Display
Info: Started post-fitting delay annotation
Info: Delay annotation completed successfully
Info: Longest tpd from source pin "Sel[0]" to destination pin "Display1[5]" is 42.900 ns
    Info: 1: + IC(0.000 ns) + CELL(3.500 ns) = 3.500 ns; Loc. = PIN_29; Fanout = 16; PIN Node = 'Sel[0]'
    Info: 2: + IC(6.500 ns) + CELL(2.300 ns) = 12.300 ns; Loc. = LC2_D7; Fanout = 2; COMB Node = 'ULA:inst|Somador_subtrator:Somador_sub|Somador1bit:inst8|inst5~4'
    Info: 3: + IC(0.600 ns) + CELL(2.300 ns) = 15.200 ns; Loc. = LC7_D7; Fanout = 2; COMB Node = 'ULA:inst|Somador_subtrator:Somador_sub|Somador1bit:inst9|inst5'
    Info: 4: + IC(2.200 ns) + CELL(2.300 ns) = 19.700 ns; Loc. = LC5_D10; Fanout = 2; COMB Node = 'ULA:inst|Somador_subtrator:Somador_sub|Somador1bit:inst10|inst5'
    Info: 5: + IC(0.600 ns) + CELL(2.300 ns) = 22.600 ns; Loc. = LC2_D10; Fanout = 1; COMB Node = 'ULA:inst|Somador_subtrator:Somador_sub|Somador1bit:inst11|inst2'
    Info: 6: + IC(2.200 ns) + CELL(2.300 ns) = 27.100 ns; Loc. = LC5_D9; Fanout = 9; COMB Node = 'ULA:inst|MuxVetor:inst|mux8-1:inst3|inst21~524'
    Info: 7: + IC(2.300 ns) + CELL(2.300 ns) = 31.700 ns; Loc. = LC7_D8; Fanout = 2; COMB Node = 'Display_Ula:inst3|Somador_subtrator:inst3|Somador1bit:inst10|inst3~23'
    Info: 8: + IC(2.200 ns) + CELL(2.300 ns) = 36.200 ns; Loc. = LC2_D2; Fanout = 1; COMB Node = 'Display_Ula:inst3|Decod_Display:inst|DisplayF:inst10|inst~53'
    Info: 9: + IC(1.600 ns) + CELL(5.100 ns) = 42.900 ns; Loc. = PIN_148; Fanout = 0; PIN Node = 'Display1[5]'
    Info: Total cell delay = 24.700 ns ( 57.58 % )
    Info: Total interconnect delay = 18.200 ns ( 42.42 % )
Info: Quartus II Classic Timing Analyzer was successful. 0 errors, 0 warnings
    Info: Peak virtual memory: 155 megabytes
    Info: Processing ended: Thu Oct 15 17:26:58 2009
    Info: Elapsed time: 00:00:04
    Info: Total CPU time (on all processors): 00:00:02


