Mudanças entre as edições de "Sistemas Digitais"

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A disciplina de Sistemas Digitais (IF675) tem como objetivo dar ao aluno conhecimentos de circuitos lógicos digitais combinacionais e seqüenciais cobrindo desde dispositivos digitais de pequena complexidade SSI, até a implementação de circuitos de média complexidade MSI.
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{{CourseBox
Durante o curso o aluno tem oportunidade de desenvolver todo o fluxo de projeto, desde a sua especificação, através de um esquema ou de uma HDL, até sua implementação, em um circuito integrado reconfigurável (FPGA - Field Programmable Gate Array). A ferramenta adotada é o Quartus no desenvolvimento para a plataforma de prototipação UP1 da Altera.  
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| name = Sistemas Digitais
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| ccProfessor = [http://www.cin.ufpe.br/~mel Manoel Eusébio]
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| ccWebsite = https://cin.ufpe.br/~if675
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| ccDateTime = Qua - 08h às 10h / Sex - 10h às 12h
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__TOC__
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A disciplina de Sistemas Digitais (IF675) tem como objetivo dar ao aluno conhecimentos de circuitos lógicos digitais combinacionais e sequenciais cobrindo desde dispositivos digitais de pequena complexidade até a implementação de circuitos de média complexidade.
== Professores ==
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Durante o curso o aluno tem oportunidade de desenvolver todo o fluxo de projeto, desde a sua especificação, através de um esquema ou de uma HDL, até sua implementação, em um circuito integrado reconfigurável (FPGA - Field Programmable Gate Array). A ferramenta adotada é o Quartus no desenvolvimento para a plataforma de prototipação UP1 da Altera.
O curso é ministrado pelo [http://cin.ufpe.br/~mel/ Prof. Manoel Eusébio de Lima], professor do Centro de Informática da UFPE, nas turmas de Ciência da Computação e pelo [www.cin.ufpe.br/~agsf/ Prof. Abel Gulhermino], professor do Centro de Informática da UFPE, nas turmas de Engenharia da Computação.
 
 
 
== Ementa ==
 
* Ágebra Booleana
 
* HDL
 
* Circuitos Combinacionais
 
* Circuitos Sequenciais
 
 
 
== Tópicos Abordados ==
 
 
 
1ª unidade:
 
* Introdução a sistemas digitais e modelos de computação
 
* Álgebra Booleana, Aritmética Binária, Portas Lógicas
 
* Simplificação e otimização de funções
 
* Projeto de circuitos combinacionais: ALU, shifters, comparator, etc.
 
 
 
2ª unidade:
 
* HDL
 
* Latches e flip flops, Modelo FSM
 
* Análise e síntese de componentes sequenciais e de memória
 
* Projeto de circuitos sequenciais: register, counters and shifters
 
* Componentes de armazenamento: memories, register files, RAMs, FIFOs, stacks, etc.
 
* Unidades de processamento e de controle
 
* Projeto de sistemas digitais
 
* Projeto e organização de processadores
 
* Avaliação
 
 
 
== Organização ==
 
=== Ciência da Computação ===
 
A disciplina é composta, atualmente, de duas unidades e cada uma contém uma mini-prova, uma prova e um projeto.
 
==== Projetos ====
 
No primeiro Projeto da disciplina (1º unidade) os alunos terão que fazer uma Unidade Lógica Aritmética (ULA) em Bloco de Diagramas utilizando a ferramenta Quartus da Altera utilizando conceitos de Circuitos Combinacionais.
 
No Segundo Projeto os alunos terão que projetar uma CPU que implemente determinadas funções na linguagem Verilog novamente utilizando a ferramenta Quartus da Altera utilizando conceitos de Circuitos Combinacionais e Sequenciais.
 
 
 
=== Engenharia da Computação ===
 
 
 
== Monitores ==
 
=== Ciência da Computação ===
 
* Danilo Ribeiro (dlr4) - Monitor Chefe
 
* Bruno Cavalcanti (bjcc)
 
* Rodrigo Calegario (rcac)
 
* Thiago Bastos (tmb2)
 
 
 
=== Engenharia da Computação ===
 
 
 
==Referências==
 
 
 
Site da Disciplina [http://www.cin.ufpe.br/~if675/ IF675]
 
<br>
 
Livros:
 
<br>
 
[http://books.google.com.br/books?id=vBlTAAAAMAAJ&q=Principles+of+Digital+Design&dq=Principles+of+Digital+Design&hl=pt-BR&sa=X&ei=4LSgT7qlBsjf0QHRteCACQ&ved=0CDkQ6AEwAA  Principles of Digital Design]
 
<br>
 

Edição atual tal como às 15h20min de 10 de novembro de 2017

Erro em Lua: Não é possível criar o processo: proc_open(/dev/null): failed to open stream: Operation not permitted A disciplina de Sistemas Digitais (IF675) tem como objetivo dar ao aluno conhecimentos de circuitos lógicos digitais combinacionais e sequenciais cobrindo desde dispositivos digitais de pequena complexidade até a implementação de circuitos de média complexidade. Durante o curso o aluno tem oportunidade de desenvolver todo o fluxo de projeto, desde a sua especificação, através de um esquema ou de uma HDL, até sua implementação, em um circuito integrado reconfigurável (FPGA - Field Programmable Gate Array). A ferramenta adotada é o Quartus no desenvolvimento para a plataforma de prototipação UP1 da Altera.